Cours Motorola

Structure dun systme microprocesseur

Logique cble :

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Logique programme :

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Architecture gnrale dun systme microprocesseur

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ROM RAM PIO p

Port A

Port B

Bus de donnes

Bus dadresse

Bus de contrle

5

Le microprocesseur ), 6&.(&.7$

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La ROM

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La RAM 2'462'

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Les dispositifs dentre-sortie 8

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Bit H (Demi-retenue)

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-

Les modes dadressage

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1. Adressage inhrent (ou implicite)

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2. Adressage immdiat

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3. Adressage direct

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4. Adressage tendu

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5. Adressage tendu indirect

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6. Adressage relatif court

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Adresse Contenu Etiquette Code op. Oprande Commentaires

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$8006 B7 E0 0A STA $E00A

$8009 B7 E0 0B PAIR : STA $E00B

$800C 3F SWI

7. Adressage relatif long

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Jeu dinstructions du 6809

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1. - Instructions de transfert de donnes

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Instruction Fonction

LD la donne en mmoire est charge dans le registre spcifie

ST Le contenu du registre interne spcifi dans linstruction est transfr dans lemplacement mmoire indiqu.

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'N>>>

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3

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PSH Empilement de(s) registre(s) dans la pile.

PUL Dpilement de(s) registre(s) de la pile.

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ssss - B A

ssss -A B

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ssss - 7 X-bas

ssss - 6 Y-haut

ssss - 5 Y-bas

ssss - 4 U-haut

ssss - 3 U-bas

ssss - 2 PC-haut

ssss - 1 PC-bas

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2. - Instructions de traitement de donnes

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ADD Addition du contenu mmoire un accumulateur

ADC Addition du contenu mmoire un accumulateur avec retenue

ABX Addition de laccumulateur B X

DAA Ajustement dcimal de lacc. A

MUL Multiplication de A par B (non signe)

SUB Soustraction du contenu mmoire un accumulateur

SBC Soustraction du contenu mmoire un accumulateur avec retenue

SEX Extension de signe de laccu. B lacc. A

11(()#,):

!

Instruction

Fonction

AND ET logique entre mmoire et registre interne

EOR XOR entre mmoire et registre interne

OR OU logique entre mmoire et registre interne

-3=4-%

FIRQ

F = 0

1 I 1 F

Sauvegarde des PC et CCR dans la pile Systme

0 E

Recherche du vecteur FIRQ contenu dans FFF6 : FFF7

0 BS

Excution du sous-programme de FIRQ

0 BA 1 BS

Continue lexcution du programme en

cours

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Espace Mmoire

Contenu de S

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Espace Mmoire

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Port A (8 bits)

Port B 0.)(-

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Bus dadresse

Bus de contrle

Contrle A

Contrle B

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Structure interne du PIA 6821

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Structure externe du PIA 6821

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Bus de donnes

Slection de

registres

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ORA

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RESET

IRQB

D0-D7

PA0-PA7

PB0-PB7

CA1

CA2

CB1

CB2

IRQA

Ampli. Bus de

Donnes

Registre dentre du bus

Slect. de

Botier

Slect. De

registres

Registre de

Contrle A (CRA)

Registre de

Sortie A (ORA)

Registre de

Sortie B (ORB)

Registre de

Contrle B (CRB)

Contrle Dinterrup.

Port A

Registre de Sens de transfert (DDRA)

Interface Avec la

Priphrie Port A

Interface Avec la

Priphrie Port B

Registre de

Sens de transfert (DDRB)

Contrle Dinterrup

.Port B

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Contrle A (CRA)

Registre de

Sortie A (ORA)

Registre de

Sortie B (ORB)

Registre de

Contrle B (CRB)

Contrle Dinterrup.

Port A

Registre de Sens de transfert (DDRA)

Interface Avec la

Priphrie Port A

Interface Avec la

Priphrie Port B

Registre de

Sens de transfert (DDRB)

Contrle Dinterrup

.Port B

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1) Introduction

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3. Sous-programmes

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Exercice :

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Instruction A trois octets

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Donne ou adresse ventuelle

Donne ou adresse ventuelle

Instruction A deux octets

Instruction A un octet

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RI Dcodeur Squenceur

Bus de donnes interne (8bits)

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Unit de commande

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Compteur-Programme PC

Registre dindex X

Registre dindex Y

Registre de page DP

Registre dtat CC

Accumulateur A Accumulateur B

Pointeur de Pile Utilisateur U

Compteur-Programme PC

Registre dindex X

Registre dindex Y

Registre de page DP

Registre dtat CC

Accumulateur A

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